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基于eFPGA 的通信基帶加速器的邏輯重構設計
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中國電子科技集團公司第五十四研究所

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中圖分類(lèi)號:

TN453

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Logic reconfiguration design of communication baseband accelerator based on eFPGA
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    摘要:

    為解決CMOS器件特征尺寸縮小帶來(lái)的SoC(System on Chip,片上系統)芯片可靠性失效的問(wèn)題,提出了一種基于eFPGA(embedded FPGA,嵌入式FPGA)的在線(xiàn)編程功能實(shí)現故障電路邏輯重構的方法。對eFPGA技術(shù)優(yōu)勢、JTAG(Joint TestAction Group,聯(lián)合測試工作組協(xié)議)工作原理進(jìn)行了分析,選取通信基帶信號處理的典型算法:FFT(Fast Fourier Transform,快速傅里葉變換)、FIR(Finite Impulse Response,有限脈沖響應)濾波算法為例,模擬通信基帶加速器功能失效時(shí),借助JTAG技術(shù)配置新的互連關(guān)系,利用eFPGA進(jìn)行邏輯重構,替代通信基帶加速器結構實(shí)現功能自愈。仿真及驗證結果顯示eFPGA在面積與功耗方面具備優(yōu)勢,此方案可以實(shí)現預期邏輯重構的功能,能有效提高系統可靠性與靈活性。

    Abstract:

    In order to solve the problem of SoC reliability failure caused by feature size reduction of CMOS devices, a scheme which realize logic reconfiguration of fault circuit based on online programming function of eFPGA is proposed. The technical advantages of eFPGA and the working principles of JTAG areanalyzed. The typical communication baseband signal processing algorithms, such as FFT algorithm and FIR filtering algorithm, are selected as example to simulate the logic reconfiguration when communication baseband accelerator function fails. JTAG technology is used to reconfigure the interconnection, therefore the eFPGA replaces the structure of communication baseband accelerator to realize function self-healing. Simulation and verification results show that eFPGA has advantages in area and power consumption. This scheme can achieve the expected logic reconfiguration function and effectively improve the reliability and flexibility of system.

    參考文獻
    相似文獻
    引證文獻
引用本文

劉朋,李斌,常迎輝,郝亞男,趙月明.基于eFPGA 的通信基帶加速器的邏輯重構設計計算機測量與控制[J].,2020,28(2):206-210.

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  • 收稿日期:2019-07-22
  • 最后修改日期:2019-08-20
  • 錄用日期:2019-08-20
  • 在線(xiàn)發(fā)布日期: 2020-02-24
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