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基于FPGA自主控制浮點(diǎn)加減乘除控制器設計
DOI:
CSTR:
作者:
作者單位:

(廣西科技大學(xué) 電氣與信息工程學(xué)院,廣西 柳州 545006 )

作者簡(jiǎn)介:

張玲玲(1988),女,河南許昌市人,碩士研究生,主要從事過(guò)程控制與自動(dòng)化裝置方向的研究。 李克儉(1962),女,湖北武漢人,教授,主要從事電力電子技術(shù)與自動(dòng)化裝置方向的研究。

通訊作者:

中圖分類(lèi)號:

TP332

基金項目:

桂科自(2011GXNSFA018153)。


Design of Floating Point Multiplication Controller of Independent Control Based on FPGA
Author:
Affiliation:

(College of Electrical and Information Engineering,Guangxi University  of Science and Technology,Liuzhou 545006,China)

Fund Project:

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    摘要:

    為實(shí)現一種能夠自主完成浮點(diǎn)數加/減、乘、除運算功能的浮點(diǎn)數算術(shù)運算執行控制器,提出了一種基于采用FPGA的并行操作設計硬連接的浮點(diǎn)算術(shù)運算控制電路及其時(shí)序控制方法,該控制器能夠自動(dòng)選擇運算器,調整內部時(shí)序脈沖的時(shí)鐘周期,自主完成操作數的配置并進(jìn)行浮點(diǎn)數加/減、乘、法運算的功能,運算結果讀到系統數據總線(xiàn);論述了該控制器的電路構成和基本原理,分析操作數配置與運算器的選擇,及內部時(shí)序脈沖作用下的執行過(guò)程,應用Verilog HDL語(yǔ)言實(shí)現相關(guān)硬件的構建和連接;通過(guò)仿真綜合測試可知,該控制器的最高頻率可達132.426 M,從輸入端口到輸出端口的延時(shí)數據為:最小延時(shí)是5.367 ns,最大延時(shí)是18.347 ns,耗用的IO輸入輸出端口占總資源的31.45%;并能夠自動(dòng)選擇運算器,自主完成相應的算術(shù)運算。

    Abstract:

    In order to achieve an execution controller which can complete the Plus/minus, multiply and divide floating point calculation function independently, this paper proposes a parallel operation based on the FPGA circuit hard-wired floating-point number operation control circuit and the sequential control method. The controller can automatically select arithmetic unit, adjust the internal clock of the sequential pulse cycle,independently complete configuration of the operands and the function of floating-point addition/subtraction, multiplication operation,. operation results transmitted to the system data bus. Discusses the circuit of the controller structure and basic principle, analyzes the operand configuration and the choice of the arithmetic unit under the action of execution. VerilogHDL language is applied to implement the building and related hardware connection. After the completion of the design the simulation test shows that the single instruction controller can independently complete the floating-point Plus/minus, multiply and divide. 

    參考文獻
    相似文獻
    引證文獻
引用本文

張玲玲,李克儉,蔡啟仲.基于FPGA自主控制浮點(diǎn)加減乘除控制器設計計算機測量與控制[J].,2014,22(10):3375-33773380.

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