混合數據采集與存儲的實(shí)現

首頁(yè) > 過(guò)刊瀏覽>2014年第22卷第10期 >3297-3300

混合數據采集與存儲的實(shí)現
DOI:
                        
                    
CSTR:
                        [cstr]
                    
作者:
                        
                        
                    
作者單位:(1.中北大學(xué) 電子測試技術(shù)國家重點(diǎn)實(shí)驗室,太原 030051; ;2.儀器科學(xué)與動(dòng)態(tài)測試教育部重點(diǎn)實(shí)驗室,太原 030051)
作者簡(jiǎn)介:尹鵬亮(1987),男,在讀碩士,主要從事測試計量技術(shù)與儀器方向的研究。 崔永俊(1973),男,副教授,在讀博士,主要從事納米技術(shù)與儀器方向的研究。
通訊作者:
中圖分類(lèi)號:TN431
基金項目:國家自然科學(xué)基金(51075375)。

Design of Mixed Analog Digital Data Acquisition and Storage

Author:

Affiliation:

(1.State Key Lab. of Electronic Measurement Technology, North University of China, Taiyuan 030051, China;2.Ministerial Key Lab. of Instrumentatim Science and Dynamic Measuremet,North University of China,Taiyuan 030051,China)

Fund Project:

摘要

圖/表

訪(fǎng)問(wèn)統計

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摘要:

設計了一種傳感器信號與GPIO口數字量隔離與采集的方案,研究了模擬信號線(xiàn)性光耦的隔離與電壓轉換技術(shù),提出了采用光耦隔離模擬量與數字信號,利用主控芯片FPGA完成單路采樣率不低于5 kHz的模擬量與數字量數據的混合編幀,使用緩沖FIFO實(shí)時(shí)完成記錄儀的發(fā)送與接收,通過(guò)對數據的的回讀來(lái)確保數據傳輸的正確性與可靠性；經(jīng)大量測試表明,該方案穩定、實(shí)用,滿(mǎn)足系統的實(shí)時(shí)性要求。

Abstract:

This paper introduces a design of analog signals and GPIO digital isolation and acquisition scheme,the research stressed the isolation of the linear optocoupler and voltage conversion technology. The analog and digital signal are isolated by optocoupler. The main control chip FPGA completed data mixed frame which contains the single channel sampling rate is not less than 5 kHz and digital data. The use of buffer FIFO is to send and receive real-time recorder. The data readed back to ensures the accuracy and reliability of data transmission .After a lot of tests,it showed that the scheme is stable、practical and meets the design requirements.

參考文獻

相似文獻

引證文獻

引用本文

尹鵬亮,張永瑞,崔永俊,李錦明.混合數據采集與存儲的實(shí)現計算機測量與控制[J].,2014,22(10):3297-3300.

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在線(xiàn)發(fā)布日期: 2015-01-15
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