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基于FPGA自主控制浮點(diǎn)加減控制器設計
DOI:
CSTR:
作者:
作者單位:

(廣西科技大學(xué) 電氣與信息工程學(xué)院,廣西 柳州 545006 )

作者簡(jiǎn)介:

張玲玲(1988-),女,河南許昌人,碩士研究生,主要從事過(guò)程控制與自動(dòng)化裝置方向的研究。[FQ)]

通訊作者:

中圖分類(lèi)號:

TP332

基金項目:

廣西科學(xué)基金(桂科自2011GXNSFA018153)。


Design of Floating Point Add and Subtract Controller of Independent Control Based on FPGA
Author:
Affiliation:

(College of Electronical and Information Engineering,Guangxi University of Science and Technology,Liuzhou 545006,China)[JZ)]

Fund Project:

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    摘要:

    為實(shí)現一種能夠自主完成浮點(diǎn)數加/減運算功能的浮點(diǎn)數加/減運算執行控制器,提出了一種基于采用FPGA并行操作電路硬連接的浮點(diǎn)數加/減運算控制電路及其時(shí)序控制方法;該控制器在接收到操作數類(lèi)型與參與運算的操作數后,在內部時(shí)序脈沖作用下,可以自主完成操作數的配置以及浮點(diǎn)數加/減法運算的功能,運算結果傳輸到系統數據總線(xiàn);論述了該控制器的電路構成和基本原理,分析操作數類(lèi)型與操作數在內部時(shí)序脈沖作用下的執行過(guò)程,應用Verilog HDL語(yǔ)言實(shí)現相關(guān)硬件的構建和連接;設計完成后通過(guò)仿真測試可知,該控制器運行的最高頻率可達178.317 M,從輸入端口到輸出端口的延時(shí)數據為:最小延時(shí)是3.185 ns,最大延時(shí)是15.336 ns,耗用的IO輸入輸出端口占總資源的27.92%,數據表明該控制器提高了運算器的運算速度,且能夠自主完成浮點(diǎn)數加/減運算。

    Abstract:

    In order to achieve the plus/minus floating point calculation function independently by on execution controller, this paper proposes a parallel operation based on the FPGA circuit hard-wired floating-point number plus/minus operation control circuit and the sequential control method. The controller can independently complete much floating-point addition and subtraction operation function of the process of operation under the influence of internal timing pluse when it receives the operand type and multioperand. operation results transmitted to the system data bus. Discusses the circuit of the controller structure and basic principle, analyzes the operand type and multioperand in internal temporal pulse under the action of execution. VerilogHDL language is applied to implement the building and related hardware connection. After the completion of the design the simulation test shows that Maximum delay is 15.336 ns, consumption of IO input/output port of total resources 27.92%, data show that the controller can improve the arithmetic unit operation speed when performing more operands floating-point addition and subtraction,

    參考文獻
    相似文獻
    引證文獻
引用本文

張玲玲,李克儉,蔡啟仲.基于FPGA自主控制浮點(diǎn)加減控制器設計計算機測量與控制[J].,2014,22(9):2941-2943.

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歷史
  • 收稿日期:2014-04-21
  • 最后修改日期:2014-05-26
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  • 在線(xiàn)發(fā)布日期: 2014-12-18
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